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電源時序的規格、電路工作和波形

羅姆半導體集團 ? 來源:羅姆半導體集團 ? 作者:羅姆半導體集團 ? 2022-06-22 12:45 ? 次閱讀

本文的關鍵要點

了解電源時序②的規格、電路工作和波形。

在上一篇文章中,介紹了使用通用電源IC實現電源時序控制的實際電路示例以及各種設置所需的常數計算。在本文中,我們一起來了解使用通用電源IC實現電源時序控制的相關電路的實際工作。

電源時序規格②:實際工作示例

下面的電路是實現上一篇中的的電源時序②的電路示例。在這里再次給出是為了便于確認電路工作。

3e2874c2-f1e1-11ec-ba43-dac502259ad0.png

實現電源時序②的電路示例

實現電源時序②的工作波形如下所示。

在施加VIN 5.0V的狀態下,將控制VOUT的開/關工作的Enable設置為“H”電平時,VOUT開始啟動。

首先是通過DCDC 1實現VOUT1的1.2V啟動并上升。在波形圖中是黃色部分。

3e3f0cbe-f1e1-11ec-ba43-dac502259ad0.png

電源時序② 工作波形

當VOUT1電壓達到為Power Good模塊IC1設置的閾值VH(即VOUT1)的90%時,OUT輸出啟用DCDC 2,第二個輸出VOUT21.5V(黃綠色)開始上升。

同樣,當VOUT2達到90%的電壓時,Power Good模塊IC2啟用DCDC 3,第三個輸出VOUT3 3.3V(淺藍色)開始上升。

這是啟動時的時序工作。

關斷時,以與啟動時相同的順序從VOUT1開始關斷。

當將Enable設為“L”電平時,DCDC 1直接被禁用并關閉,同時放電電路導通,在設定時間內將OUT1降至接地電平的程度。

當VOUT1低于Power Good模塊IC1的閾值VL(即0.5V)時,IC1的OUT輸出會禁用DCDC 2,同時導通放電電路,以降低VOUT2。

當VOUT2低于Power Good模塊IC2的閾值VL(即0.5V)時,如前一階段一樣,IC2的OUT輸出會禁用DCDC 3并導通放電電路以降低VOUT3。

這樣就完成了三個關斷時序并關閉所有輸出。

原文標題:R課堂 | 電源時序規格②:實際工作示例

文章出處:【微信公眾號:羅姆半導體集團】歡迎添加關注!文章轉載請注明出處。

審核編輯:湯梓紅

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原文標題:R課堂 | 電源時序規格②:實際工作示例

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