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電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>基于FPGA的DRR算法的實現

基于FPGA的DRR算法的實現

2009-08-07 | rar | 140 | 次下載 | 3積分

資料介紹

考慮到QoS需求以及帶寬的有效利用,高速有效的調度算法成為當前路由器中研究
的熱點。DRR算法具有較低的設計復雜度以及適應變長分組交換的特點,使之便于在T-Bit路由器中實現。文中介紹了設計的主要模塊以及具體的硬件實現方案。
隨著IP 寬帶技術的不斷發展,對路由器的性能也提出了越來越高的要求,同時為了保證IP QoS,如何提供并實現有效的隊列調度也成為了研究的熱點和難點。隊列調度的基本
功能是:在中繼節點中,按照不同的調度粒度(scheduling granularity)從節點連接的多個隊列中進行選擇。 一個有效的隊列調度機制取決于它采用的調度算法,衡量調度算法的性能指標主要有:公平性、時延特性、吞吐量、對惡意流的阻隔能力等。這些指標和QoS 是密切相關的,同時為了便于實現,對調度算法的復雜度也有著相應的要求。
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