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?????????本文從順序迭代的角度提出了一種高效的，容易實現的，占用資源少的FFT 算法結構， 通過合理的設計使得系統占資源少而且高效，同時亦足夠簡單。本文詳細描述了整個設計，在精簡程度、完全的流水化、控
制結構方式、蝶形運算、時序配合、存儲地址生成等方面均有一些特點。
關鍵詞：現場可編程器件(FPGA) 快速傅立葉變換(FFT) 超高速硬件描述語言(VHDL)
?????????隨著微電子技術的飛速發展，傳統的可編程邏輯器件正在向大容量、高性能、低成本的方向發展，以CPLD/FPGA 為代表的可編程邏輯器件受到了世界范圍內廣大電子設計工程師的普遍歡迎，應用日益廣泛。芯片集成度和速度的不斷提高使得各種數字信號處理算法的硬件高速實現成為可能。隨著各大廠商發布的越來越先進的EDA 工具軟件，自動化設計程度隨之提高。傳統的 FFT 使用軟件或DSP 實現。在高速處理的時候實時性比較難滿足。因此使用FPGA實現FFT 算法能滿足現代的高速運算要求。
制結構方式、蝶形運算、時序配合、存儲地址生成等方面均有一些特點。
關鍵詞：現場可編程器件(FPGA) 快速傅立葉變換(FFT) 超高速硬件描述語言(VHDL)
?????????隨著微電子技術的飛速發展，傳統的可編程邏輯器件正在向大容量、高性能、低成本的方向發展，以CPLD/FPGA 為代表的可編程邏輯器件受到了世界范圍內廣大電子設計工程師的普遍歡迎，應用日益廣泛。芯片集成度和速度的不斷提高使得各種數字信號處理算法的硬件高速實現成為可能。隨著各大廠商發布的越來越先進的EDA 工具軟件，自動化設計程度隨之提高。傳統的 FFT 使用軟件或DSP 實現。在高速處理的時候實時性比較難滿足。因此使用FPGA實現FFT 算法能滿足現代的高速運算要求。
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