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線程級(jí)推測(cè)（TLS）技術(shù)的有效運(yùn)用可提高多核芯片的硬件資源利用率，其已在多種串行應(yīng)用的自動(dòng)并行化工作中取得了較好效果，但目前缺乏對(duì)HPEC應(yīng)用子程序級(jí)線程推測(cè)方面的有效分析。針對(duì)該問(wèn)題，設(shè)計(jì)子程序級(jí)推測(cè)的剖析機(jī)制及核心數(shù)據(jù)結(jié)構(gòu)，選取HPEC中7個(gè)具有代表性的程序，挖掘其子程序級(jí)的最大潛在并行性并結(jié)合線程粒度、并行覆蓋率、子程序調(diào)用次數(shù)、數(shù)據(jù)依賴及源碼，對(duì)程序的加速比進(jìn)行分析。實(shí)驗(yàn)結(jié)果表明， fdirsvd、db和ga程序的加速比在2.2331， tdfir程序的加速效果最好，加速比達(dá)到221.78，對(duì)于包含多次非重度數(shù)據(jù)依賴子程序調(diào)用的應(yīng)用，更適合采用子程序級(jí)TLS技術(shù)測(cè)試其并行性。
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