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基于FPGA的32階FIR濾波器的設(shè)計(jì)與實(shí)現(xiàn)

2017-11-10 | rar | 0.3 MB | 次下載 | 免費(fèi)

資料介紹

  研究了一種采用FPGA實(shí)現(xiàn)32階FIR濾波器硬件電路方案;討論了窗函數(shù)的選擇、濾波器的結(jié)構(gòu)以及系數(shù)量化問題;研究了FIR濾波器的FPGA實(shí)現(xiàn),各模塊的設(shè)計(jì)以及如何優(yōu)化硬件資源,提高運(yùn)行速度等問題。實(shí)驗(yàn)結(jié)果表明了該方法的有效性。

  根據(jù)系數(shù)的最大值是0.063561,所以縮放因子取8,量化后的頻率響應(yīng)如圖,滿足通帶線形相位的要求和阻帶最小衰減的要求,如圖1示。

基于FPGA的32階FIR濾波器的設(shè)計(jì)與實(shí)現(xiàn)

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