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54/74165
8 位移位寄存器（并行輸入，互補串行輸出）
簡要說明
54/74165 為 8 位移位寄存器,其主要電特性的典型值如下：
型號 fm PD
54/74165 26MHz 210mW
54/74LS165A 35MHz 90mW
當移位/置入控制端（SH/L
＿＿
D
＿＿
）為低電平時，并行數據（A－H）被置入寄
存器，而時鐘（CLK,CLK INH）及串行數據（SER）均無關。當 SH/L
＿＿
D
＿＿
為高
電平時，并行置數功能被禁止。
CLK和CLK INK在功能上是等價的，可以交換使用。當CLK和CLK INK有一
個為低電平并且SH/L
＿＿
D
＿＿
為高電平時，另一個時鐘可以輸入。當CLK和CLK INK
有一個為高電平時，另一個時鐘被禁止。只有在CLK為高電平時CLK INK才可變
為高電平。
引出端符號
CLK,CLK INH 時鐘輸入端（上升沿有效）
A－H 并行數據輸入端
SER 串行數據輸入端
QH 輸出端
Q
＿＿
H 互補輸出端
SH/L
＿＿
D
＿＿
移位控制/置入控制（低電平有效）
邏輯及封裝圖
8 位移位寄存器（并行輸入，互補串行輸出）
簡要說明
54/74165 為 8 位移位寄存器,其主要電特性的典型值如下：
型號 fm PD
54/74165 26MHz 210mW
54/74LS165A 35MHz 90mW
當移位/置入控制端（SH/L
＿＿
D
＿＿
）為低電平時，并行數據（A－H）被置入寄
存器，而時鐘（CLK,CLK INH）及串行數據（SER）均無關。當 SH/L
＿＿
D
＿＿
為高
電平時，并行置數功能被禁止。
CLK和CLK INK在功能上是等價的，可以交換使用。當CLK和CLK INK有一
個為低電平并且SH/L
＿＿
D
＿＿
為高電平時，另一個時鐘可以輸入。當CLK和CLK INK
有一個為高電平時，另一個時鐘被禁止。只有在CLK為高電平時CLK INK才可變
為高電平。
引出端符號
CLK,CLK INH 時鐘輸入端（上升沿有效）
A－H 并行數據輸入端
SER 串行數據輸入端
QH 輸出端
Q
＿＿
H 互補輸出端
SH/L
＿＿
D
＿＿
移位控制/置入控制（低電平有效）
邏輯及封裝圖
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