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CY7C1643KV18和CY7C1645KV18是1.8V同步流水線SRAM，配備QDR II+架構。與QDR-II體系結構類似，QDR-II+體系結構由兩個獨立的端口組成：用于訪問內存陣列的讀端口和寫端口。讀端口有專用的數據輸出以支持讀操作，寫端口有專用的數據輸入以支持寫操作。QDR II+體系結構具有獨立的數據輸入和數據輸出，完全無需“周轉”與常見I/O設備一起存在的數據總線。每個端口通過公共地址總線訪問。讀寫地址的地址鎖存在輸入（K）時鐘的交替上升沿上。對QDR II+讀寫端口的訪問彼此完全獨立。為了最大限度地提高數據吞吐量，讀寫端口都配備了DDR接口。每個地址位置都與四個18位字（CY7C1643KV18）或36位字（CY7C1645KV18）相關聯，這些字依次進入或離開設備。由于數據在兩個輸入時鐘（K和K）的每個上升沿上都被傳輸到設備中或從設備中傳出，因此在通過消除總線“周轉”簡化系統設計的同時，最大限度地提高了內存帶寬。通過端口選擇來完成深度擴展，從而使每個端口能夠獨立運行。所有同步輸入通過由K或K輸入時鐘控制的輸入寄存器。所有數據輸出都通過由K或K輸入時鐘控制的輸出寄存器。寫入是通過片上同步自定時寫入電路進行的。有關相關文檔的完整列表，請單擊此處。
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