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電子發(fā)燒友網>電子資料下載>電子資料>如何使用含相位體制的ADC設計實現DRFM

如何使用含相位體制的ADC設計實現DRFM

2020-09-11 | pdf | 0.33 MB | 次下載 | 1積分

資料介紹

  數字射頻存儲器(DRFM)具有對射頻和微波信號的存儲及再現能力,已發(fā)展成為現代電子戰(zhàn)系統(tǒng)和儀器測試系統(tǒng)的重要組成部分。作為DRFM 的核心部分,超高速ADCDAC 的性能直接決定了它處理模擬信號的能力。但是,由于半導體工藝及器件性能的限制,高采樣率、高分辨率的ADC 及DAC 難以實現。由于相位數字化比傳統(tǒng)的幅度數字化有多種優(yōu)點,且采用相位量化可降低對上述電路的要求,所以含相位體制ADC 及DAC 的DRFM 系統(tǒng)得到廣泛應用[1~4 ]。本文利用GaAs MESFET 全離子注入非自對準常規(guī)工藝設計了用于3bit 相位體制DRFM 系統(tǒng)的單片超高速相位體制ADC。測試結果表明,電路可在2GHz 時鐘速率下完成采樣、量化,達到1.2Gbp s 的輸出碼流速率,其瞬時帶寬可達150MHz,具備±0.22LSB 的相位精度。

  電路設計

  3bit 相位體制ADC 的量化對象是輸入信號的相位量,基本功能是將輸入的兩路正交模擬信號轉換為四路含相位信息數字信號。輸出信號是占空比為1:1、頻率與輸入正交信號同頻率的方波信號,但每相鄰兩路之間的相位差為45°[3 ]。3bit 相位體制ADC 的輸入輸出時序關系及真值表分別如圖1、表1 所示。所以,3bit 相位體制ADC 的輸出信號每周期含8 個相位態(tài),電路的轉換速率為輸入模擬信號頻率的8 倍。

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