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      電子發燒友網>電子資料下載>電子資料>使用千兆位收發器分數PLL的全數字VCXO替代方案

      使用千兆位收發器分數PLL的全數字VCXO替代方案

      2023-09-14 | pdf | 1.14 MB | 次下載 | 免費

      資料介紹

      本應用筆記提供了一個設計用于替代外部電壓控制的系統晶體振蕩器 （VCXO） 電路，利用千兆位收發器中的功能和關聯的 PLL。常見的設計要求是將收發器輸出的頻率或相位鎖定到輸入源（稱為環路、恢復或從時序）。傳統上，外部時鐘清理器件或VCXO和PLL組件用于為以下收發器，因為基于FPGA邏輯的時鐘通常噪聲太大。雖然有效，但外部時鐘組件的功耗和成本損失是累加的，因為每個單獨的時鐘通道已生成。當使用多個通道或在低成本系統中時，成本可能是重要。此外，添加許多外部時鐘源提供了更多機會板級串擾和干擾。
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