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本文主要介紹 HLS 案例的使用說明，適用開發環境： Windows 7/10 64bit、Xilinx Vivado
2017.4 、Xilinx Vivado HLS 2017.4 、Xilinx SDK 2017.4。
Xilinx Vivado HLS (High-Level Synthesis，高層次綜合) 工具支持將 C 、C++等語言轉化
成硬件描述語言，同時支持基于 OpenCL 等框架對 Xilinx 可編程邏輯器件進行開發，可加
HLS 基本開發流程如下：
(1) HLS 工程新建/工程導入
(2) 編譯與仿真
(3) 綜合
(4) IP 核封裝
(5) IP 核測試
HLS 案例位于產品資料“4-軟件資料\Demo\FPGA-HLS-demos\”目錄下， 案例目錄詳細
說明如下表。
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