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鑒于短時標在航天、電子及電力系統中的需求，本文闡述了以FPGA 為主處理器對GPS 接收機進行數據采集處理，提供高精度短時標及短時標對應的時間碼相關信息。為了確保時標的精度，減少時間信息解碼過程中的采樣誤差，從方法、設計兩方面考慮，采取了一系列的措施，保證了時標設計的精度。
關鍵詞：短時標；GPS 接收機；FPGA；多時鐘域處理；
Abstract: the thesis expatiated digital collection and processing for GPS receiver based on FPGA used as master processor, providing short timing scale accurately and information related with timing code. The system adopted a series of measures considering from means to design and supported the precision of design, for decreasing the collection error in the process of timing decoding and ensuring the precision of timing.
Keyword: short timing scale；GPS receiver; FPGA; multiple clock processing;
關鍵詞：短時標；GPS 接收機；FPGA；多時鐘域處理；
Abstract: the thesis expatiated digital collection and processing for GPS receiver based on FPGA used as master processor, providing short timing scale accurately and information related with timing code. The system adopted a series of measures considering from means to design and supported the precision of design, for decreasing the collection error in the process of timing decoding and ensuring the precision of timing.
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